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PLL工程师（2027年校招）

高拓讯达(北京)微电子股份有限公司 · 北京市

External listingFull-time21 days ago

About The Role

  • 1、负责CMOS射频IC时钟相关模块的设计，主要包括PLL及各类振荡器；
  • 2、与算法组和ASIC组密切合作完成对标准的解读，进一步提取对各个模块时钟要求的定义；
  • 3、设计及指导射频IC版图；
  • 4、深入参与芯片测试与系统测试，特别是指导实际产品系统中发现的时钟相关的问题的解决；
  • 5.、完成设计评审报告以及设计文档。
  • 1、电子工程或集成电路专业硕士或博士研究生在读；
  • 2、有深厚的CMOS射频和模拟IC设计基础，包括设计，仿真，版图及测试；
  • 3、有扎实的射频IC设计经验，有产品经验者为佳 ；
  • 4、熟悉主流射频IC设计工具及一种以上电磁仿真工具；
  • 5、会使用Matlab，Perl, C,Skill, Ocean等语言之一编写简单程序；
  • 6、具有无线通信系统的知识；有很强的电路分析能力和解决问题的能力；
  • 7、工作踏实认真，有团队合作精神及良好的沟通能力，能够清晰表述观点。

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