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标准单元库设计主任工程师-Standard Cell Library Design Staff Engineer(J17219)

ChangXin Memory (CXMT) · 上海市, 安徽省·合肥市

External listingFull-timeabout 2 months ago

About The Role

  1. 标准单元库设计与优化：主导标准单元库的架构、设计、仿真与优化，确保单元库满足工艺节点的性能目标；
  2. 单元characterization与PPA优化：在PVT各工艺角下对单元进行characterization，持续推动PPA（时序、功耗、面积）优化，生成符合质量要求的全套库文件；
  3. 版图协作与验证：与版图团队紧密合作，确保版图通过DRC/LVS检查，并满足工艺节点的电气规范（EM/IR压降、ESD规则、失配等）；
  4. 自动化脚本开发与维护：开发并维护高复用性的自动化脚本（Python、TCL、SKILL），加速原理图生成、网表提取、仿真回归、质量检查及PDK流程；
  5. 技术文档撰写与前沿跟踪：撰写并维护完整的技术文档（数据手册、应用指南、发布说明、characterization报告），持续跟踪学术与行业前沿技术并反馈至产品路线图
  6. 教育背景与专业知识：微电子、电子工程或相关专业，硕士及以上学历；
  7. 专业技能与资格：精通Synopsys/Cadence/Mentor设计流程，含HSPICE/Spectre、PrimeTime、Liberate/Variety、Virtuoso、Calibre、StarRC、Innovus，熟练掌握Liberty格式（.lib、.db）及STA约束，了解CCS/NLDM、ECSM、LVF及EM模型，具备扎实的脚本能力（Python、TCL、Perl、SKILL）；
  8. 行业与专业经验：3年以上标准单元或定制电路设计经验，具有先进CMOS流片成功经验；
  9. 项目/任务成果：主导过至少一款标准单元库从架构设计到Characterization的完整项目，并推动PPA优化落地；
  10. 其他要求：深入理解CMOS器件物理、工艺变化及可靠性，具备PDK开发与Pcell脚本经验者优先，沟通清晰，善于协作，富有推动半导体技术极限的热情。

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